题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL27 |
不重叠序列检测
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2023-03-05
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答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2023-03-05
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2023-03-05
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答案正确
| < 1ms | 0K | Verilog | |
VL10 |
使用函数实现数据大小端转换
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2023-03-05
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答案正确
| < 1ms | 0K | Verilog | |
VL9 |
使用子模块实现三输入数的大小比较
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2023-03-05
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答案正确
| < 1ms | 0K | Verilog | |
VL8 |
使用generate…for语句简化代码
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2023-03-05
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答案正确
| < 1ms | 0K | Verilog | |
VL7 |
求两个数的差值
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2023-03-05
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答案正确
| < 1ms | 0K | Verilog | |
VL6 |
多功能数据处理器
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2023-03-05
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答案正确
| < 1ms | 0K | Verilog | |
VL5 |
位拆分与运算
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2023-03-05
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答案正确
| < 1ms | 0K | Verilog | |
VL3 |
奇偶校验
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2023-03-04
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答案正确
| < 1ms | 0K | Verilog | |
VL2 |
异步复位的串联T触发器
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2023-03-04
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答案正确
| < 1ms | 0K | Verilog | |
VL1 |
四选一多路器
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2023-03-04
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答案正确
| < 1ms | 0K | Verilog | |
VL62 |
序列发生器
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2023-03-04
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答案正确
| < 1ms | 0K | Verilog | |
VL62 |
序列发生器
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2023-03-04
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答案正确
| < 1ms | 0K | Verilog | |
VL59 |
根据RTL图编写Verilog程序
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2023-03-04
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答案正确
| < 1ms | 0K | Verilog | |
VL59 |
根据RTL图编写Verilog程序
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2023-03-03
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答案正确
| < 1ms | 0K | Verilog |
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