题解 | #输出1#

输出1

https://www.nowcoder.com/practice/4f34974710f7486a8a2515df1d50b298

`timescale 1ns/1ns

module top_module(
    output wire one
);

assign one = 1;

endmodule

在模块中添加输出一栏。

同时,搞清楚reg wire类型的赋值方式

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昨天 14:40
浙江大学 设计
无语😓 就喜欢找我茬,研究生怎么了 研究生就是天才吗 就得所有报告文件都会,最烦做表
我推的MK:是这样的,那些领导就是自己什么都不懂就把所有东西扔给你,指望白嫖你的劳动力,如果你的表现不如预期就启动攻击学历模式,这都学不会是怎么考上浙大的
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Elastic90:公司不要求加班,但 又不允许你准点下班,经典又当又立
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