题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL72 |
全加器
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL71 |
乘法与位运算
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL70 |
序列检测器(Moore型)
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL67 |
十六进制计数器
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL65 |
状态机与时钟分频
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL64 |
时钟切换
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL63 |
并串转换
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL62 |
序列发生器
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL61 |
自动售卖机
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL59 |
根据RTL图编写Verilog程序
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL24 |
边沿检测
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL23 |
ROM的简单实现
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL22 |
根据状态转移图实现时序电路
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL21 |
根据状态转移表实现时序电路
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL20 |
数据选择器实现逻辑电路
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL19 |
使用3-8译码器①实现逻辑函数
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL18 |
实现3-8译码器①
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL17 |
用3-8译码器实现全减器
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL16 |
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog | |
VL15 |
优先编码器Ⅰ
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2024-05-14
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答案正确
| < 1ms | 0K | Verilog |
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