紧张的山羊在对齐目标 level
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南京大学
2025
集成电路IC设计
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VL16
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
2024-01-18
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Verilog
VL15
优先编码器Ⅰ
2024-01-17
答案正确
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Verilog
VL14
用优先编码器①实现键盘编码电路
2024-01-16
答案正确
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Verilog
VL13
优先编码器电路①
2024-01-15
答案正确
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Verilog
VL12
4bit超前进位加法器电路
2024-01-15
答案正确
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Verilog
VL11
4位数值比较器电路
2024-01-15
答案正确
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Verilog
VL11
4位数值比较器电路
2024-01-15
答案正确
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Verilog
VL10
使用函数实现数据大小端转换
2024-01-12
答案正确
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Verilog
VL9
使用子模块实现三输入数的大小比较
2024-01-12
答案正确
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Verilog
VL8
使用generate…for语句简化代码
2024-01-12
答案正确
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Verilog
VL7
求两个数的差值
2024-01-12
答案正确
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VL6
多功能数据处理器
2024-01-12
答案正确
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VL5
位拆分与运算
2024-01-11
答案正确
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VL5
位拆分与运算
2024-01-11
答案正确
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VL4
移位运算与乘法
2024-01-11
答案正确
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VL3
奇偶校验
2024-01-10
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VL2
异步复位的串联T触发器
2024-01-10
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四选一多路器
2024-01-10
答案正确
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VL1
四选一多路器
2024-01-10
答案正确
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VL1
四选一多路器
2024-01-10
答案正确
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