题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
---|
VL46 |
同步FIFO
|
2024-06-06
|
答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
|
2024-06-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
|
2024-06-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
|
2024-05-31
|
答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
|
2024-05-31
|
答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
|
2024-05-30
|
答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
|
2024-05-30
|
答案正确
| < 1ms | 0K | Verilog | |
VL24 |
边沿检测
|
2024-05-30
|
答案正确
| < 1ms | 0K | Verilog | |
VL24 |
边沿检测
|
2024-05-30
|
答案正确
| < 1ms | 0K | Verilog | |
VL23 |
ROM的简单实现
|
2024-05-30
|
答案正确
| < 1ms | 0K | Verilog | |
VL23 |
ROM的简单实现
|
2024-05-30
|
答案正确
| < 1ms | 0K | Verilog | |
VL22 |
根据状态转移图实现时序电路
|
2024-05-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL5 |
位拆分与运算
|
2024-05-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL10 |
使用函数实现数据大小端转换
|
2024-05-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL9 |
使用子模块实现三输入数的大小比较
|
2024-05-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL8 |
使用generate…for语句简化代码
|
2024-05-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL7 |
求两个数的差值
|
2024-05-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL4 |
移位运算与乘法
|
2024-05-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL6 |
多功能数据处理器
|
2024-05-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL6 |
多功能数据处理器
|
2024-05-29
|
答案正确
| < 1ms | 0K | Verilog |
关注他的用户也关注了: