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香港理工大学
2020
集成电路IC设计
IP属地:广东
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题解
VL15
信号级联合并
2023-05-16
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Verilog
VL14
对信号按位操作
2023-05-16
答案正确
< 1ms
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Verilog
VL13
位运算与逻辑运算
2023-05-16
答案正确
< 1ms
0K
Verilog
VL12
信号顺序调整
2023-05-16
答案正确
< 1ms
0K
Verilog
VL11
多位信号
2023-05-16
答案正确
< 1ms
0K
Verilog
VL10
逻辑运算2
2023-05-14
答案正确
< 1ms
0K
Verilog
VL9
模拟逻辑芯片
2023-05-14
答案正确
< 1ms
0K
Verilog
VL8
逻辑运算
2023-05-14
答案正确
< 1ms
0K
Verilog
VL7
XOR 门
2023-05-14
答案正确
< 1ms
0K
Verilog
VL6
NOR 门
2023-05-14
答案正确
< 1ms
0K
Verilog
VL5
与门
2023-05-13
答案正确
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Verilog
VL4
反相器
2023-05-13
答案正确
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Verilog
VL3
多wire连接
2023-05-13
答案正确
< 1ms
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Verilog
VL2
wire连线
2023-05-13
答案正确
< 1ms
0K
Verilog
VL1
输出1
2023-05-13
答案正确
< 1ms
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Verilog
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