牛客724980941号 level
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中国水利水电科学研究院
2025
数字IC前端设计
IP属地:湖北
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题解
VL46
同步FIFO
2024-11-14
答案正确
< 1ms
0K
Verilog
VL60
使用握手信号实现跨时钟域数据传输
2024-11-14
答案正确
< 1ms
0K
Verilog
VL55
Johnson Counter
2024-11-14
答案正确
< 1ms
0K
Verilog
VL55
Johnson Counter
2024-11-14
答案正确
< 1ms
0K
Verilog
VL45
异步FIFO
2024-11-14
答案正确
< 1ms
0K
Verilog
VL65
状态机与时钟分频
2024-11-14
答案正确
< 1ms
0K
Verilog
VL62
序列发生器
2024-11-14
答案正确
< 1ms
0K
Verilog
VL65
状态机与时钟分频
2024-11-14
答案正确
< 1ms
0K
Verilog
VL45
异步FIFO
2024-11-14
答案正确
< 1ms
0K
Verilog
VL48
多bit MUX同步器
2024-11-14
答案正确
< 1ms
0K
Verilog
VL48
多bit MUX同步器
2024-11-14
答案正确
< 1ms
0K
Verilog
VL45
异步FIFO
2024-10-14
答案正确
< 1ms
0K
Verilog
VL33
非整数倍数据位宽转换8to12
2024-09-23
答案正确
< 1ms
0K
Verilog
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