题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL59 |
根据RTL图编写Verilog程序
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2022-04-23
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答案正确
| < 1ms | 0K | Verilog | |
VL23 |
ROM的简单实现
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
VL22 |
根据状态转移图实现时序电路
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
VL21 |
根据状态转移表实现时序电路
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2022-04-14
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答案正确
| < 1ms | 0K | Verilog | |
VL63 |
并串转换
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2022-04-12
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答案正确
| < 1ms | 0K | Verilog | |
VL63 |
并串转换
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2022-04-12
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答案正确
| < 1ms | 0K | Verilog |
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