双非🐭 level
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南京信息工程大学
2024
FPGA工程师
IP属地:江苏
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题解
VL40
占空比50%的奇数分频
2023-10-09
答案正确
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Verilog
VL37
时钟分频(偶数)
2023-10-09
答案正确
< 1ms
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Verilog
VL35
状态机-非重叠的序列检测
2023-10-08
答案正确
< 1ms
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Verilog
VL28
输入序列不连续的序列检测
2023-10-08
答案正确
< 1ms
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Verilog
VL27
不重叠序列检测
2023-10-08
答案正确
< 1ms
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Verilog
VL26
含有无关项的序列检测
2023-10-08
答案正确
< 1ms
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Verilog
VL25
输入序列连续的序列检测
2023-10-08
答案正确
< 1ms
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Verilog
VL24
边沿检测
2023-10-08
答案正确
< 1ms
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Verilog
VL23
ROM的简单实现
2023-10-08
答案正确
< 1ms
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Verilog
VL22
根据状态转移图实现时序电路
2023-10-08
答案正确
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Verilog
VL21
根据状态转移表实现时序电路
2023-10-08
答案正确
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Verilog
VL3
奇偶校验
2023-10-08
答案正确
< 1ms
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Verilog
VL40
占空比50%的奇数分频
2023-08-26
答案正确
< 1ms
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Verilog
VL12
4bit超前进位加法器电路
2023-08-22
答案正确
< 1ms
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Verilog
VL29
信号发生器
2023-08-05
答案正确
< 1ms
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Verilog
VL29
信号发生器
2023-08-05
答案正确
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0K
Verilog
VL28
输入序列不连续的序列检测
2023-07-28
答案正确
< 1ms
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Verilog
VL27
不重叠序列检测
2023-07-28
答案正确
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Verilog
VL26
含有无关项的序列检测
2023-07-27
答案正确
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Verilog
VL25
输入序列连续的序列检测
2023-07-27
答案正确
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Verilog
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