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2023-01-31 01:53

南京师范大学数字IC前端设计

题解 | #移位运算与乘法#

`timescale 1ns/1ns module multi_sel( input [7:0]d , input clk, input rst, output reg input_grant, output reg [10:0]out ); //*************code***********// reg [1:0] count; reg [7:0] d_ff1; reg [7:0] d_ff2; reg [7:0] d_ff3; always@(posedge clk or negedge rst) begin...

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2022-07-27 19:35

南京师范大学数字IC前端设计

题解 | #四选一多路器#

1,组合逻辑可以使用always@(*)搭配case或者assign. 2,testbench记得加上$finish，否则会提示超时。 `timescale 1ns/1ns module mux4_1( input [1:0]d1,d2,d3,d0, input [1:0]sel, output[1:0]mux_out ); //*************code***********//     wire [1:0]d1;     wire [1:0]d2;     wire [1:0]d3;   &...

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2022-07-27 19:30

已编辑

南京师范大学数字IC前端设计

题解 | #四选一多路器#

1,组合逻辑可以使用always@(*)搭配case或者assign。 2,Testbench记得加上$finish，否则会提示超时。 `timescale 1ns/1ns module mux4_1( input [1:0]d1,d2,d3,d0, input [1:0]sel, output[1:0]mux_out ); //*************code***********// wire [1:0]d1; wire [1:0]d2; wire [1:0]d3; wire [1:0]d0; wire [1:0]sel; wire [1:0]mux_out; reg [1...

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