题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL33 |
非整数倍数据位宽转换8to12
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2022-09-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL33 |
非整数倍数据位宽转换8to12
|
2022-09-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL33 |
非整数倍数据位宽转换8to12
|
2022-09-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL32 |
非整数倍数据位宽转换24to128
|
2022-09-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL32 |
非整数倍数据位宽转换24to128
|
2022-09-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL31 |
数据累加输出
|
2022-09-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL31 |
数据累加输出
|
2022-09-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL31 |
数据累加输出
|
2022-09-01
|
答案正确
| < 1ms | 0K | Verilog | |
VL30 |
数据串转并电路
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2022-08-04
|
答案正确
| < 1ms | 0K | Verilog | |
VL29 |
信号发生器
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2022-07-25
|
答案正确
| < 1ms | 0K | Verilog | |
VL29 |
信号发生器
|
2022-07-25
|
答案正确
| < 1ms | 0K | Verilog | |
VL29 |
信号发生器
|
2022-07-25
|
答案正确
| < 1ms | 0K | Verilog | |
NC144 |
懂二进制
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2022-07-08
|
答案正确
| 3ms | 400K | C++ | |
VL28 |
输入序列不连续的序列检测
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2022-07-06
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2022-07-04
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2022-07-04
|
答案正确
| < 1ms | 0K | Verilog | |
235499 |
根据RTL图编写Verilog程序
|
2022-06-09
|
答案正确
| < 1ms | 0K | Verilog | |
235499 |
根据RTL图编写Verilog程序
|
2022-06-09
|
答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2022-06-09
|
答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
|
2022-06-09
|
答案正确
| < 1ms | 0K | Verilog |
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