题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL59 |
根据RTL图编写Verilog程序
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2024-07-11
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答案正确
| < 1ms | 0K | Verilog | |
VL37 |
时钟分频(偶数)
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2024-07-11
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答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2024-07-11
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答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2024-07-11
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2024-07-11
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答案正确
| < 1ms | 0K | Verilog | |
VL30 |
数据串转并电路
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2024-05-13
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答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2024-05-13
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答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2024-05-13
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2024-05-13
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答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2024-05-13
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2024-05-13
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答案正确
| < 1ms | 0K | Verilog | |
VL60 |
使用握手信号实现跨时钟域数据传输
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2023-06-27
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答案正确
| < 1ms | 0K | Verilog | |
VL60 |
使用握手信号实现跨时钟域数据传输
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2023-06-27
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答案正确
| < 1ms | 0K | Verilog | |
VL76 |
任意奇数倍时钟分频
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2023-06-27
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答案正确
| < 1ms | 0K | Verilog | |
VL76 |
任意奇数倍时钟分频
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2023-06-27
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答案正确
| < 1ms | 0K | Verilog | |
VL76 |
任意奇数倍时钟分频
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2023-06-27
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答案正确
| < 1ms | 0K | Verilog | |
VL76 |
任意奇数倍时钟分频
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2023-06-27
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答案正确
| < 1ms | 0K | Verilog | |
VL77 |
编写乘法器求解算法表达式
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2023-06-27
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答案正确
| < 1ms | 0K | Verilog |
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