不想泡池子的牛肉丸 level
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门头沟学院
2021
数字IC前端设计
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题解
VL40
占空比50%的奇数分频
2022-08-29
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Verilog
VL37
时钟分频(偶数)
2022-08-28
答案正确
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Verilog
VL36
状态机-重叠序列检测
2022-08-28
答案正确
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Verilog
VL35
状态机-非重叠的序列检测
2022-08-28
答案正确
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Verilog
VL34
整数倍数据位宽转换8to16
2022-08-28
答案正确
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Verilog
VL33
非整数倍数据位宽转换8to12
2022-08-28
答案正确
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Verilog
VL32
非整数倍数据位宽转换24to128
2022-08-28
答案正确
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Verilog
VL31
数据累加输出
2022-08-27
答案正确
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Verilog
VL30
数据串转并电路
2022-08-26
答案正确
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Verilog
VL30
数据串转并电路
2022-08-26
答案正确
< 1ms
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Verilog
VL29
信号发生器
2022-08-23
答案正确
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Verilog
VL28
输入序列不连续的序列检测
2022-08-22
答案正确
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Verilog
VL27
不重叠序列检测
2022-08-21
答案正确
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Verilog
VL26
含有无关项的序列检测
2022-08-21
答案正确
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Verilog
VL25
输入序列连续的序列检测
2022-08-20
答案正确
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Verilog
VL25
输入序列连续的序列检测
2022-08-20
答案正确
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Verilog
VL24
边沿检测
2022-08-20
答案正确
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Verilog
VL23
ROM的简单实现
2022-08-20
答案正确
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Verilog
VL23
ROM的简单实现
2022-08-20
答案正确
< 1ms
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Verilog
VL23
ROM的简单实现
2022-08-20
答案正确
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Verilog
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