题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL60 |
使用握手信号实现跨时钟域数据传输
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2022-09-04
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答案正确
| < 1ms | 0K | Verilog | |
VL37 |
时钟分频(偶数)
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2022-08-29
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答案正确
| < 1ms | 0K | Verilog | |
VL72 |
全加器
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2022-08-29
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答案正确
| < 1ms | 0K | Verilog | |
VL36 |
状态机-重叠序列检测
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2022-08-26
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答案正确
| < 1ms | 0K | Verilog | |
VL35 |
状态机-非重叠的序列检测
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2022-08-26
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答案正确
| < 1ms | 0K | Verilog | |
VL31 |
数据累加输出
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2022-08-26
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答案正确
| < 1ms | 0K | Verilog | |
VL30 |
数据串转并电路
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2022-08-26
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答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2022-08-26
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答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2022-08-21
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2022-08-21
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答案正确
| < 1ms | 0K | Verilog | |
VL23 |
ROM的简单实现
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2022-08-21
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答案正确
| < 1ms | 0K | Verilog | |
VL24 |
边沿检测
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2022-08-21
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答案正确
| < 1ms | 0K | Verilog | |
VL38 |
自动贩售机1
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2022-08-15
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答案正确
| < 1ms | 0K | Verilog | |
VL77 |
编写乘法器求解算法表达式
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2022-08-13
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答案正确
| < 1ms | 0K | Verilog | |
VL76 |
任意奇数倍时钟分频
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2022-08-13
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答案正确
| < 1ms | 0K | Verilog | |
VL74 |
异步复位同步释放
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2022-08-13
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答案正确
| < 1ms | 0K | Verilog | |
VL73 |
串行进位加法器
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2022-08-12
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答案正确
| < 1ms | 0K | Verilog | |
VL72 |
全加器
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2022-08-11
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答案正确
| < 1ms | 0K | Verilog | |
VL71 |
乘法与位运算
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2022-08-11
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答案正确
| < 1ms | 0K | Verilog | |
VL70 |
序列检测器(Moore型)
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2022-08-11
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答案正确
| < 1ms | 0K | Verilog |
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