2022心想事成 - 个人主页动态

2022-07-19 21:21

更简便的方法,通过cnt产生clk_n时钟，然后直接用待分频时钟上升沿对时钟clk_n打半拍得到时钟clk_p，最后将clk_p和clk_n相或就可以得到占空比为50%的7分频时钟 `timescale 1ns/1ns module odo_div_or    (     input    wire  rst ,     input    wire&n...

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2022-04-11 19:17

哈尔滨工业大学（深圳） IC验证工程师

海思数字芯片实习一面

4.9海思一面，整体体验还好。毕竟是非科班，面试官人很好，不会太刁难。面试流程：1.自我介绍2.做题，序列检测，画状态转移图，有错的地方面试官会给提示。3.问项目，共享屏幕，画结构图，边画边讲，面试官会随时提问。4.反问环节希望最近尽快主管面，然后泡池子去吧。😔

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