牛客486906616号
2023-06-09 20:59 西安交通大学 FPGA工程师
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我用仿真试了一下，对与时钟信号上升沿平齐的信号跳变进行判断时，如果该信号是wire型（如题中set），则条件语句即刻执行，如果该信号是reg型（如题中num_reg），则条件语句延迟一拍执行
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