题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL45 |
异步FIFO
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2023-07-19
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答案正确
| < 1ms | 0K | Verilog | |
VL46 |
同步FIFO
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2023-07-18
|
答案正确
| < 1ms | 0K | Verilog | |
VL46 |
同步FIFO
|
2023-07-18
|
答案正确
| < 1ms | 0K | Verilog | |
VL31 |
数据累加输出
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2023-06-26
|
答案正确
| < 1ms | 0K | Verilog | |
VL31 |
数据累加输出
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2023-06-26
|
答案正确
| < 1ms | 0K | Verilog | |
VL30 |
数据串转并电路
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2023-06-26
|
答案正确
| < 1ms | 0K | Verilog | |
VL30 |
数据串转并电路
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2023-06-26
|
答案正确
| < 1ms | 0K | Verilog | |
VL30 |
数据串转并电路
|
2023-06-26
|
答案正确
| < 1ms | 0K | Verilog | |
VL29 |
信号发生器
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2023-06-26
|
答案正确
| < 1ms | 0K | Verilog | |
VL29 |
信号发生器
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2023-06-26
|
答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2023-06-25
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2023-06-25
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2023-06-21
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2023-06-21
|
答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2023-06-21
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2023-06-21
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答案正确
| < 1ms | 0K | Verilog | |
VL24 |
边沿检测
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2023-06-21
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答案正确
| < 1ms | 0K | Verilog | |
VL23 |
ROM的简单实现
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2023-06-21
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答案正确
| < 1ms | 0K | Verilog | |
VL22 |
根据状态转移图实现时序电路
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2023-06-20
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答案正确
| < 1ms | 0K | Verilog | |
VL22 |
根据状态转移图实现时序电路
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2023-06-19
|
答案正确
| < 1ms | 0K | Verilog |
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