题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL35 |
状态机-非重叠的序列检测
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2024-07-30
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答案正确
| < 1ms | 0K | Verilog | |
VL36 |
状态机-重叠序列检测
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2024-07-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL35 |
状态机-非重叠的序列检测
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2024-07-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL34 |
整数倍数据位宽转换8to16
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2024-07-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL34 |
整数倍数据位宽转换8to16
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2024-07-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL33 |
非整数倍数据位宽转换8to12
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2024-07-29
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答案正确
| < 1ms | 0K | Verilog | |
VL32 |
非整数倍数据位宽转换24to128
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2024-07-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL32 |
非整数倍数据位宽转换24to128
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2024-07-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL33 |
非整数倍数据位宽转换8to12
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2024-07-29
|
答案正确
| < 1ms | 0K | Verilog | |
VL32 |
非整数倍数据位宽转换24to128
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2024-07-29
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答案正确
| < 1ms | 0K | Verilog | |
VL31 |
数据累加输出
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2024-07-28
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答案正确
| < 1ms | 0K | Verilog | |
VL30 |
数据串转并电路
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2024-07-28
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答案正确
| < 1ms | 0K | Verilog | |
VL30 |
数据串转并电路
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2024-07-28
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答案正确
| < 1ms | 0K | Verilog | |
VL29 |
信号发生器
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2024-07-27
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答案正确
| < 1ms | 0K | Verilog | |
VL29 |
信号发生器
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2024-07-27
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答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2024-07-27
|
答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2024-07-27
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2024-07-27
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答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2024-07-27
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2024-07-26
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答案正确
| < 1ms | 0K | Verilog |
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