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24/10/9 笔试24/10/10 测评-------一面 线下 1个半小时 马上出结果项目粗问了一点概述的内容，使用资源等不多赘述。1. CPLD 和 FPGA 的区别；2. CMOS 和 TTL 电平相接的问题；2. 设计 MOS 管与非门、非门；3. 用基本门电路设计 D 触发器；4. 用基本门电路设计 2 多路选择器；5. 用多路选择器和非门设计异或逻辑；6. 给最小项式子，画出卡诺图和逻辑代数；7. 将逻辑代数化成仅与非的形式；8. 手撕 5 奇数分频占空比 50％ verilog；9. 笔试选择题。