题解 | #信号级联合并#
信号级联合并
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`timescale 1ns/1ns
module top_module(
input [4:0] a, b, c, d, e, f,
output [7:0] w, x, y, z );
wire [31:0]t;
assign t = {a,b,c,d,e,f,2'b11};//这里的2'b11,不能写成2b'3
assign w = t[31:24];
assign x = t[23:16];
assign y = t[15:8];
assign z = t[7:0];
endmodule
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